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海思如何将国产EDA的缺陷率大幅降低?

2026-09-09

2020年,全球三大EDA厂商开始全面停止对海思的产品供应,导致海思失去了工具更新和技术支持,芯片设计工作因此受到严重影响,这并不是一个逐步替代的故事,而是一场生存危机的考验。出乎意料的是,这一危机却成就了国产EDA在多年来未能解决的问题。尽管国产EDA企业在资金和研发人才上并不匮乏,但他们缺少的是一份关于缺陷的详细清单。Synopsys、Cadence和Siemens EDA的真正优势在于过去三十多年间积累的经验清单,这份清单记录着全球最复杂芯片在其工具上遇到的各种问题及解决方式。相较之下,国产EDA企业由于成立时间较短,缺乏高复杂度实际设计案例,因而无法识别自家工具中存在的问题。

海思在这场变革中扮演了关键角色,承担了国产EDA的重要设计任务,并愿意提供真实案例来帮助国产工具不断完善。然而,仅仅有面临挑战的场景还不够,海思需要一套系统的机制来将问题的发现与解决进行规范化。在这方面,“碧玄岩”团队的出现至关重要。

在未引入碧玄岩之前,海思在芯片设计中设置了三道质量保护网。其中第一道由国产EDA供应商负责进行功能和性能验证,第三道则是海思内部的最高密级区域,涉及实际产品的设计案例。面对国际大厂时,这种体系足以保障设计质量,然而面对国产工具时则显现出不足之处,导致大量问题直接流向海思工程师。 龙8头号玩家国际

为了缓解这一压力,碧玄岩团队应运而生,其运作方式与传统测试不同,团队成员并不深谙芯片设计。碧玄岩通过分析真实案例,从中识别出问题,再在小规模平台上复现问题模式。经过大量的模式复现和分析,他们逐步总结出规律,不断生成新的测试方案。这种方法的有效性得到了海思芯片软件测试负责人认可,称之为“设计建模”的一种新思路。引入碧玄岩后,RC寄生参数提取工具的缺陷率从原先的34.8%下降至3.1%,而EMIR工具的遗漏率也大幅降低。

为了提升工具的综合质量,海思还采取了三层测试用例集的方法。首先,依照Verilog语言规范构建的用例集,由海思工具团队主导,积累超过18万个用例;其次,通过每年举办的工程师考核,数千名工程师围绕同一问题提交各自的实现,累计攒下超过三万份丰富多样的实现;最后,利用自身真实项目中的复杂基准直接应对实际生产压力。结合这三层用例,全面覆盖设计规范、写法多样性和实际应用场景。

随着缺陷清单的逐渐完善,工具也进入了最后的量产验证阶段,未通过的工具将不再向内部设计团队开放,而合格的工具则进入“桃花岛”快速迭代系统。自2025年9月以来,合作伙伴通过该系统发出超过5000个版本,每月发布400多个版本,相较于传统的大版本更新,国产工具在效率和应变能力上都有了显著提升。 龙8头号玩家国际